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168免费大型图库助手 Achronix推出突破性FPGA系列 以更高性能和体面性已足高带宽数据添速行使请求
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浏览:150 发布日期:2020-02-06

添州圣克拉拉2019年5月22日 /美通社/ -- 挑供基于FPGA(现场可编程门阵列)的硬件添速器设备和高性能eFPGA(嵌入式FPGA)IP的全球领先企业Achronix半导体公司(Achronix Semiconductor Corporation)今天推出崭新的创新式FPGA系列,以已足人造智能/机器学习(AI/ML)以及高带宽数据添速行使一连挑高的请求。在一栽经过高度优化的崭新架构上打造而成的Achronix Speedster®7t系列超越了传统的FPGA解决方案,具有相通ASIC(特定用途集成电路芯片)的性能、FPGA的普及体面性和可简化设计的添强功能。

Speedster7t FPGA系列是特意遵命AI/ML和高带宽做事负载的请求来设计的,采用了革命性的崭新2D片上网络(NoC)和高密度的新式机器学习处理器(MLP)阵列。Speedster7t系列将FPGA可编程性与ASIC路由组织及计算引擎相结相符,创造出一栽名为“FPGA ”的新技术。

随着AI/ML用例的快捷演变,人们必要用新的解决方案来已足更高性能、更高变通性和更快走向市场等各栽请求。在云云的背景下,Semico Research Corp.展望AI行使周围的FPGA的市场周围将在异日四年内扩大3倍,达到52亿美元。

Achronix半导体公司总裁兼首席实走官罗伯特-布莱克(Robert Blake)外示:“吾们正处在智能化、自学习计算高速发展的首步阶段,这将对吾们平时生活的方方面面产生普及的影响。Speedster7t系列的推出是Achronix历史画卷上最浓墨重彩的一笔,它代外了四代硬件架议和柔件开发的创新与学习,是吾们与主要客户亲昵配相符的收获。该系列融相符了变通的FPGA技术和ASIC中央效果,开创出崭新的‘FPGA ’级芯片,真实突破了高性能计算添速的周围。”

为开发Speedster7t系列FPGA,Achronix的设计团队重新设计了整个FPGA架构,力求做到片上处理、组件互连和外部I/O(输入/输出设备)之间的均衡,同时最大限度地挑高数据浓密型做事负载的吞吐量,最典型的就是基于边缘和服务器的AI/ML行使、网络和存储方面的负载。

Speedster7t器件采用了台积电(TSMC)的7nm FinFET(7纳米鳍式场效答晶体管)制造工艺,可批准来自众个高速数据源的大量数据168免费大型图库助手,再将数据分发到可编程的片上算法和处理单元上168免费大型图库助手,然后以尽能够矮的耽延实现计算添速。Speedster7t器件包括高带宽GDDR6接口、400G以太网端口和PCI Express Gen5 -- 所有这些组件都互相连接168免费大型图库助手,能在挑供ASIC级带宽的同时,完善保留FPGA的可编程性。

Semico Research的ASIC和SoC(片上体系)首席市场分析师里奇-瓦夫日尼亚克(Rich Wawrzyniak)评论说:“为了处理直接瞄准AI行使的海量数据,创新式硅架构一再问世,而崭新推出的Achronix Speedster7t FPGA系列就是最益的例子。它将数学函数、内存和可编程性融相符到机器学习处理器中,再结相符跨芯片二维NoC组织,挑供了清除瓶颈和确保数据在整个器件中解放起伏的最佳途径。对AI/ML行使而言,内存带宽就是总共,Achronix Speedster7t系列在这方面竖立首极高的性能标准。”

针对计算性能进走优化

Speedster7t FPGA的中央是新式MLP中的大周围并走可编程计算元件阵列,可挑供业界最高的基于FPGA的计算密度。MLP是高度可配置的计算浓密型单元块,声援4到24位的整数格式和高效的浮点模式,包括直接声援TensorFlow的16位格式以及添强型块浮点格式,将每个MLP的计算引擎增补一倍。

MLP与嵌入式内存块周详耦相符,清除了传统上与FPGA路由有关的耽延,确保以750 MHz(兆赫)的最高性能将数据传送到MLP。高密度计算和高性能数据传输的结相符使处理器组织能够让基于FPGA的有效运算速度Tops(万亿次/秒)达到最高。

世界级带宽

对于高性能计算和机器学习体系而言,特意关键的一点就是片外内存的带宽要高,才能挑供懈弛冲众个数据流。Speedster7t是唯一声援最高带宽外部内存技术——GDDR6内存——的FPGA器件。由于每个GDDR6内存限制器都能声援512 Gbps(吉比特每秒)带宽,Speedster7t器件中最众有8个GDDR6限制器,云云GDDR6总带宽便达到4 Tbps(太比特每秒),内存带宽与基于HBM(高带宽内存)的FPGA相通,但成本要矮得众。

美光(Micron)计算与网络营业部营销副总裁马尔-汉弗莱(Mal Humphrey)外示:“美光很起劲与Achronix配相符打造全球首个与GDDR6直接相连、可已足高带宽内存需求的FPGA。像云云极具创新特色且可扩展的解决方案将推动AI周围进一步添大不搀杂,而这一周围必要异构计算选项和高性能内存相结相符来添速数据洞察。”

除高内存带宽之外,Speedster7t器件还包括业界性能最高的接口和端口,能声援极高带宽的数据流;采用72个最高性能的SerDes,运走速率在1到112 Gbps之间;带有前向纠错(FEC)功能的强硬400G以太网MAC(媒体接入限制器);声援4x 100G和8x 50G两栽配置;以及强硬PCI Express Gen5限制器,每个限制器有8或16个通道。

超高效的数据传输

固然从Speedster7t的高速I/O和内存端口传输众太比特数据很容易超出一个传统FPGA的面向比特、可编程互连组织的路由容量,但Speedster7t架构包括一个创新、高带宽的二维NoC,在整个FPGA组织中横向及纵向铺睁开,连接FPGA所有高速数据和内存接口。Speedster7t NoC就像是叠添在FPGA互连城市街道体系上的高速公路网络,声援片上处理引擎之间的高带宽通信。NoC中的每一走或每一列都经过两个相符走业标准的256位单向AXI信道来通信,频率为2 Ghz(吉赫兹),同时在每个倾向进走512 Gbps的数据传输。

专用2D NoC的行使极大简化了高速数据传输,并确保数据流能够轻盈地定向到整个FPGA架构中的任一自定义处理引擎。最主要的是,NoC解决了传统FPGA会展现的拥塞和性能瓶颈题目,传统FPGA行使可编程路由和逻辑查找外(LUT)资源,在整个FPGA中传送数据流。这栽高性能网络不光能够挑高Speedster7t FPGA的总带宽容量,还能够在降矮功耗的同时,挑高LUT有效容量。

针对坦然关键型和硬件保证型行使的坦然功能

Speedster7t FPGAs具备最先辈的比特流坦然功能,以众层退守机制,确保比特流的保密性和完善性,从而有效招架第三方抨击的胁迫。基于防篡改物理不走克隆功能(PUF)对密钥进走添密,比特流的添密和验证采用的是256位AES-GCM手段。为了退守边信道抨击,比特流被分割开,每个分段操纵单独导出的密钥,而解密硬件采用了差分功耗分析(DPA)退守对策。此外,Speedster7t还行使2048位RSA公钥认证制定来激活解密和验证硬件。用户能够坦然地添载坦然的比特流,由于这是一栽特意设计的配置,已经过RSA公钥、AES-GCM私钥和CRC(循环冗余校验码)校验的验证。

郑重且矮成本的ASIC转换方案,已足大批量生产需求

Achronix是唯逐一家同时挑供自力FPGA和Speedcore™嵌入式FPGA IP的公司。Achronix在Speedster7t FPGA中操纵的便是Speedcore eFPGA IP技术,声援从Speedster7t FPGA向ASIC的无缝转换。FPGA行使清淡具有必须保持可编程性的功能,而其他则是专用于特定体系行使的固定功能。在向ASIC转换时,固定功能能够强硬为ASIC组织,从而缩短芯片尺寸,并降矮成本和功耗。经过Speedcore eFPGA IP将Speedster7t FPGA转换成ASIC,客户能够撙节高达50%的功耗和90%的成本。

供货

Speedster7t FPGA器件挑供363K至2.6M六输入LUT架构配置。声援Speedcore eFPGA和Speedchip™ FPGA芯片粒等所有Achronix产品的ACE设计工具现已上市。

第一批用于评估的器件和开发板将于2019年第四季度推出。

“带着世界赋予我们的裂痕去生活,去用残损的手掌抚平彼此的创痕,固执地迎向幸福。”我们度过了一个艰难的除夕,但一个个强壮的日子依然在前面。大年初一,祝打开这条推送的你在新的一年,诸事顺遂,如意平安。

原标题:737请求着陆

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